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IDT70V639S
High-Speed 3.3V 128K x 18 Asynchronous Dual-Port Static RAM
Pin Names
Industrial and Commercial Temperature Ranges
Left Port
CE 0L , CE 1L
R/ W L
OE L
A 0L - A 16L
I/O 0L - I/O 17L
SEM L
INT L
BUSY L
UB L
LB L
V DDQL
OPT L
Right Port
CE 0R , CE 1R
R/ W R
OE R
A 0R - A 16R
I/O 0R - I/O 17R
SEM R
INT R
BUSY R
UB R
LB R
V DDQR
OPT R
M/ S
V DD
Names
Chip Enables
Read/Write Enable
Output Enable
Address
Data Input/Output
Semaphore Enable
Interrupt Flag
Busy Flag
Upper Byte Select
Lower Byte Select
Power (I/O Bus) (3.3V or 2.5V) (1)
Option for selecting V DDQX (1,2)
Master or Slave Select
Power (3.3V) (1)
V SS
TDI
TDO
TCK
TMS
TRST
Ground (0V)
Test Data Input
Test Data Output
Test Logic Clock (10MHz)
Test Mode Select
Reset (Initialize TAP Controller)
5621 tbl 01
5
NOTES:
1. V DD , OPT X , and V DDQX must be set to appropriate operating levels prior to
applying inputs on I/O X .
2. OPT X selects the operating voltage levels for the I/Os and controls on that port.
If OPT X is set to V IH (3.3V), then that port's I/Os and controls will operate at 3.3V
levels and V DDQX must be supplied at 3.3V. If OPT X is set to V IL (0V), then that
port's I/Os and controls will operate at 2.5V levels and V DDQX must be supplied
at 2.5V. The OPT pins are independent of one another—both ports can operate
at 3.3V levels, both can operate at 2.5V levels, or either can operate at 3.3V
with the other at 2.5V.
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